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在雷达宽带接收系统中,数字中频接收采样率的选择要受限于射频系统的整体设计架构,信号处理系统需要的基带信号数据率可能无法通过对采样信号进行整数抽取获得。针对宽带系统采样率高、数字下变频采用并行多相滤波算法结构、基带信号由多个并行支路组成的特点,以及FPGA处理速率的限制,宽带信号分数抽取运算通常只能采用并行多相方式实现。在宽带数字下变频并行多路基带信号的基础上,通过并行多相内插滤波和并行多相抽取滤波算法,不需要提高FPGA的处理时钟,实现对大带宽信号的分数抽取运算。 相似文献
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介绍了一种基于频分复用信号的宽带数字收发设计。根据软件无线电基本理论给出了系统的硬件具体实现和软件处理流程,描述了基于FPGA平台的并行FIR滤波器和并行CIC滤波器的高效实现方法。给出了宽带数字收发系统的仿真和测试结果。该系统硬件结构简洁,逻辑资源开销小,通用性和扩展性强。 相似文献
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提出了一种可变分数延时宽带数字滤波器的优化设计方法,该方法首先采用内插的方法提高采样率,降低信号的归一化带,再采用Farrow结构来实现分数延时,通过抽取,恢复信号的初始采样率.其实现形式采用基于多相滤波的级联结构,使得内插和抽取相互抵消,降低滤波器的阶数,提高运算效率.采用基于FPGA的并行分布式算法,设计利用了器件的结构特点以及与器件特性独立的2种方法,在时域实现了高速、高阶的宽带分数延时滤波器,并在Altera Stratix FPGA上进行了仿真验证,最高工作频率分别为184 MHz和119 MHz. 相似文献
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数字信号处理,常常是计算密集和高性能需求的。FIR滤波器由于其稳定和简单,在数字信号处理中常被采用。随着实时性和低成本要求的提高,对FIR滤波器的要求也越来越高。单一的流水结构和并行FIR结构都不能很好地满足实现性要求。因此,在这里提出一种用于FPGA实现的并行流水结构的FIR滤波器的实现方案。 相似文献
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地空高速数据链的关键技术 总被引:1,自引:0,他引:1
高速数据传输是地空数据链的发展趋势。当前器件的工作速度是高速应用的瓶颈,为了能在较低速度的器件上实现高速处理,必须根本性地改变算法结构,采用并行处理方式。并行结构会对解调器的时间同步和载波同步造成影响,需加以研究。为实现高速数据解调,提出了并行处理的解调器结构,研究了并行结构下的定时同步和载波同步方法,分析了克服符号间干扰的判决反馈均衡算法,探讨了抑制宽带信号中窄带干扰的自适应干扰对消方法。 相似文献
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在宽带、超宽带应用中,单一信号带宽达几百兆赫兹;或者在不同中频同时调制多个信号产生的宽带信号也达数百兆赫兹,用常规的数字下变频方法很难实现。文章提出了一种基于DFT滤波器组的高效数字下变频结构,分析了该解调算法的特点和实现性能。对已知信号带宽和中频的宽带信号,对比了DFT滤波器组和多相分解算法的性能。对信号带宽和中频均在变化的信号,给出了实现思路。最后,给出了该DFT滤波器组的硬件实现方案。 相似文献
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小波去噪是建立在小波变换基础上的一种滤波方法,选择不同的小波函数和分解层数可以调整滤波器的特性。小波去噪具有结构简单和性能稳定的特点。为了获得随钻测量中的解码数据,选用高精度A/D转换芯片ADS1211,以TMS320F2812作为控制核心,设计实现了数据采集电路和小波去噪算法。通过波形对比证实了小波去噪的实际效果。 相似文献
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宽带波束形成技术的研究 总被引:1,自引:0,他引:1
在很多情况下,要求基阵能够不失真地接收宽带信号,因此要求波束形成器的波束图具有与频率无关的特性。深入研究了利用自适应方法设计具有特定频率响应的FIR滤波器用于进行时域宽带波束形成的应用,给出了仿真结果,验证了算法的有效性。采用FPGA或DSP实现带通滤波器是一项成熟的技术,所以通过设计特定频率响应的FIR滤波器来实现宽带波束形成技术在工程上是可实现的。 相似文献
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盲源分离技术是信号处理和神经网络领域近年来的一个热点研究课题,由于其能够从观测的混合信号中恢复出源信号,而对源信号和混合系统的先验知识要求很少,因此在语音信号处理、无线信号处理、生物医学信号处理、地震信号处理,以及图像增强等方面都具有非常重要的理论意义和实用价值。信息最大化盲源分离算法能够有效地分离语音信号的瞬时混合,但是不能分离超高斯信号(如语音信号)和亚高斯信号(如正弦信号)的混合。基于此,本文讨论了扩展信启、最大化盲源分离算法,通过仿真表明,该算法可以有效的对各种源信号的线性即时混合进行分离,实验证明了该算法的有效性。 相似文献
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提出了WOLA(Weighted Overlap-Add)并行结构的低时延DFT滤波器组的设计和FPGA实现方法.为降低系统总体时延,在综合考虑传递失真、混迭失真的基础上,将群时延引入系统目标函数,并采用非对称综合原型滤波器设计方法,提出迭代算法,实现了DFT滤波器组低时延优化设计.通过对DFT滤波器组中分析和综合功能的关键模块采用多路并行乘法、多级流水加法链设计,实现了并行的WOLA结构DFT滤波器组,降低FPGA实现的计算时延.整个设计在Xilinx公司的Zynq7020型号FPGA芯片上进行实现.PESQ测试表明,设计的DFT滤波器组能取得较好的语音质量.与串行WOLA结构的实现对比表明,在16kHz语音采样率下,并行的WOLA结构FPGA实现的总时延能降低1.192ms,其中群时延降低12%,计算时延降低29.2%. 相似文献
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压缩感知理论指出,稀疏信号可以通过以低于奈奎斯特采样的测量数据重建出原始信号。针对高分辨率SAR成像在奈奎斯特理论下所面临的高速A/D采样、大数据量存储、传输等问题挑战。本文提出了一种基于压缩感知理论的多发多收高分辨率SAR二维成像算法。该算法减轻了高分辨率SAR成像的压力,采用压缩感知处理降低了A/D采样速率、数据量... 相似文献
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