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在突发OFDM系统中采用短训练序列STS互相关实现符号同步时,要进行大量自相关和互相关运算,硬件实现复杂度高。提出基于STS延迟自相关的符号同步改进算法,降低了硬件实现复杂度。仿真结果表明,该算法在瑞利衰落信道下误码率达10^-3以下,可保证正常通信。硬件设计时通过使用RAM替代移位寄存器、乘法器和累加器复用、公式化简等,减少了电路所需资源。FPGA综合结果表明,该设计占用触发器资源比现有电路节约75%左右,查找表资源节约22%左右。 相似文献
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有限域乘法器是RS编码器中的主要部分。提出一种有限域乘法器的优化策略,选用系数对称的生成多项式,全局共享出现频率较高的异或逻辑单元,大大降低了编码器的硬件实现的复杂度,最后设计实现了RS(255,239)编码器电路,仿真验证功能正确。文章设计的RS编码器电路占用硬件资源更小,非常适于VLSI的实现。 相似文献
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