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一种高速高精度比较器的设计 总被引:1,自引:1,他引:0
基于预放大锁存快速比较理论,提出了一种高速高精度CMOS比较器的电路拓扑.该比较器采用负载管并联负电阻的方式提高预放大器增益,以降低失调电压.采用预设静态电流的方式提高再生锁存级的再生能力,以提高比较器的速度.在TSMC0.18μm工艺模型下,采用Cadence Specture进行仿真.结果表明,该比较器在时钟频率为1GHz时,分辨率可以达到0.6mV,传输延迟时间为320ps,功耗为1mW. 相似文献
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随着IC制造工艺水平的提高,信号的上升沿越来越快,由此就会引发许多反射、串扰、过冲和下冲等信号不完整的问题。由于这些问题都是由IC芯片的边沿速率提升导致,因此统称它们为高速问题。分析了各种高速问题中反射、串扰、过冲和下冲等产生的原因机理,并总结出了在PCB设计过程中的解决方法。 相似文献
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