四进制大规模集成电路

日本东北大学工学部与松下电器公司已共同研制成以新的信息处理法为基础的多值逻辑运算大规模集成电路。现在的计算机处理是组合了0和1的二值信号信息,新的大规模集成电路在二值上增加了2和3的状态,用四值计算。这是一种与运算元件高速化、高集成化相关的技术,其计算时间比老产品缩短了1/3,芯片面积和功耗都减少一半。     

多值逻辑基本运算的神经网络实现

多层感知器神经网络是典型的人工神经网络模型。算后，将其推广到多值逻辑。根据感知器神经元的分类特点，系统中的基本运算，从而也实现了任意三值逻辑函数。本文在分析二值感知器神经网络实现二值数字逻辑运采用三层前向稳健感知器神经网络实现了三值格代数。     

一种新型的MV-DYL电路多元逻辑(DYL)在多元逻辑应用中的新发展

以往科学家们总是以新器件的出现,及随之使整机产生了惊人的变化来划分计算机发展历史。然而一旦多值逻辑系统付诸实现,多值逻辑学说得到应用,这种高效率的计算机结构的出现,将可能使计算机技术进入更高的水平。我国DYL集成电路的发明为实现上述目标提供了新的希望。 本文指出,多元逻辑中的线性“与或”门本质上就是一种很好的多值逻辑“与或”门。它与其他电路配合可以构成一种新的多值逻辑电路(简称为MV-DYL)。通过比较和实验证明,MV-DYL电路在与二值DYL电路相同的功耗-时延积条件下,可以获得更高的信息密度。MV-DYL电路比三值CMOS和多值I~2L电路结构简单、容易制作和可靠性高。     

任意值数的时序逻辑电路设计

本文提出了一种值数可任意扩展的多值逻辑存贮单元——DYL多值D触发器。文中将二值时序电路设计方法推广到多值逻辑系统中,运用DYL电路的线性与或门和阈门以及多值D触发器,实现了任意值数的时序逻辑电路设计。     

基于比较器的四值电流型CMOS加减电路设计

该文通过对电流型CMOS电路的阈值控制引入了多值电流型比较器。与2值逻辑电路相比,多值逻辑电路的单条导线允许更多的信息传输。相较于电压信号,电流信号易实现加、减等算术运算,在多值逻辑的设计上更加方便。同时提出了基于比较器的4值基本单元设计方法,实现了4值取大、取小以及反向器的设计,在此基础上设计实现了加法器和减法器。该设计方法在2值、3值以及n值逻辑上同样适用。实验结果表明所设计的电路具有正确的逻辑功能,较之相关文献电流型CMOS全加器有更低的功耗和更少的晶体管数。     

光学一般三值逻辑运算器件的结构

首次提出用光学线性器件实现一般三值逻辑运算的方法.除了具有一般电子多值逻辑运算器件的优点外,还可用于全并行运算,输入输出信号相同,可串接,对一般的三值逻辑运算可不用基本运算合成,直接实现.可用于更一般的多值(大于三的)逻辑运算.     

基于多值逻辑的模糊逻辑函数分析与综合

本文首先提出了模糊逻辑和多值逻辑的相似性，并从开关信号理论出发建立了多值逻辑阈运算和模糊函数取值区间有限等级的对应关系，进而提出了利用多值逻辑阈运算实现模糊逻辑函数分析与综合的算法，并用该算法对几个模糊逻辑函数实例进行了分析与综合，实例操作表明，该算法具有操作简单，规范，方便快捷的特点，是分析和综合模糊逻辑函数的有效方法。     

多值逻辑学习控制

本文提出一种由多个既关联又独立的子网络构成的用于逼近非线性函数的多值学习网络（ＫＬＮ），并在此基础上，研究了具有自学习功能的多值逻辑控制。网络运算主要为整数的加法和逻辑判断。仿真结果表明，基于ＫＬＮ的多值逻辑控制系统对复杂非线性系统具有良好的学习控制性能，且具有计算简单和省时的特点。     

基于多值逻辑电路和二值PLA的硬件模糊控制器

本文基于多值逻辑电路和二值可编程逻辑阵列，提出一种模糊控制器硬件设计方案。     

第八届全国多值逻辑与模糊逻辑学术会议征文通知

一、第八届全国多值与模糊逻辑学术会议（MVL＆FL’98）将于1998年12月在深圳特区召开，本届会议将由中国计算机学会多值逻辑与模糊逻辑专业委员会。深圳大学共同主办．为了推动和发展我国多值逻辑与模糊逻辑的理论和应用的研究，使其早日在国民经济中得到推广和应用，会议欢迎该领域的各类研究报告和综述报告．二、会议内容A、多值逻辑与模糊逻辑基础理论；B、多值逻辑与模糊逻辑的工程设计与应用：器件、器件物理及计算机模拟、电路与系统及其在国民经济中的应用；C、多值逻辑与模糊逻辑和软计算：在神经网络、进化计算、模糊系统、计…     

Theory of differential current switches and logic design of ternary ECL circuits at switch level

Starting from the viewpoint that the switch states and signal values in a digital circuit should be described separately by two different kinds of variable, the interaction between the switching element and signal in multi-valued ECL circuits is analysed and two types of connection operations, threshold switching operation and current switching operation, are proposed. The properties and circuit realizations of these new operations are discussed and the theory of differential current switches applicable to ECL circuits is established. Examples of basic ternary ECL circuits confirm that this theory can effectively guide the logic design of ternary ECL circuits at switch level. The circuits are verified by using the SPICE II program. They have the same logic level difference and transient characteristic as binary ECL circuits. Since the multi-valued ECL circuit uses only one set of power supply and can set several threshold values by using reference levels, it can be fabricated using conventional ECL techniques and is compatible with binary ECL circuits.     

采用vMOS管的多值计数器设计

通过对νMOS管特性和多值逻辑电路设计原理的研究,本文提出一种新型多值计数器的设计方案。该方案利用νMOS管具有多输入栅加权信号控制及浮栅上的电容耦合效应等特性,结合二值逻辑编码方法,实现电路的多值输出。用PSPICE对所设计的电路模拟验证,结果表明,所设计的电路逻辑功能正确,结构简单,功耗低,且通用性强,易于实现。     

三值绝热多米诺文字运算电路开关级设计

通过对绝热多米诺电路和多值电路的研究,提出一种新颖的低功耗三值文字运算电路的开关级设计方案。该方案首先通过开关—信号理论推导出逻辑0和2的文字运算电路开关级结构式及电路;然后利用三种文字运算之间互斥与互补的约束关系得到逻辑1的文字运算输出信号,同时通过波形转换电路使电路的输出转换为较规则的缓变梯形波;最后利用Spice软件对所设计的电路进行仿真,结果显示所设计的三值绝热多米诺文字运算电路具有正确的逻辑功能,与常规多米诺三值文字运算电路相比,能耗节省约39%。     

Implementation of Multi-Valued Logic Gates Using Full Current-Mode CMOS Circuits

In this paper, a novel multi-valued logic gate set is designed by using only current-mode CMOS circuits. The gate set consists of min, max, inverter, literal, and cyclic operators based on a current-mode, versatile, novel threshold topology. They are shown to exhibit better static and dynamic behavior and consume less area compared to previous MVL design topologies and binary-logic counterparts. The gate circuits are investigated in terms of analog design aspects, such as mismatch and noise. The proposed topology is compared to previous topologies in terms of attainable radix and DC characteristics. A radix-8 multiplex function and a radix-8 full-adder circuit is designed to demonstrate the advantages of new current-mode multi-valued logic circuits.     

基于模代数的三值维持阻塞触发器及其应用

本文给出了基于模代数理论的三值维持阻塞触发器,并将其应用到时序逻辑电路设计中。由于多值模代数中的两个基本运算和运算结果均为多值信号,所以它的应用避免了以往在采用基于Ｐｏｓｔ代数的三值触发器时,由于输入、输出信号不匹配而必须增加附加编码电路的问题。设计实例表明,该触发器具有更强的逻辑功能,它使得移位寄存器类的时序电路设计得以显著简化。     

Implementation of multi-valued logic, simultaneous literaloperations with full CMOS current-mode threshold circuits

A versatile current-mode threshold circuit is introduced to implement novel literal and complementary literal gates, which are essential to Postian multi-valued logic implementations. The designed circuits can realise more than one literal operation simultaneously, and exhibit better dynamic behaviour in contrast to previous designs     

High-speed CMOS demultiplexer with redundant multi-valued logic

This paper describes an 11-Gb/s CMOS demultiplexer with redundant multi-valued logic. The proposed circuit receives serial binary data which is converted to parallel redundant multi-valued data. The converted data are reconverted to parallel binary data. By the redundant multi-valued data conversion, the redundant multi-valued logic makes it possible to achieve higher operating speeds than that of a conventional binary logic. The implemented demultiplexer consists of eight integrators. The circuit is designed with a 0.35?µm standard CMOS process. The validity and effectiveness are verified through HSPICE simulation. The demultiplexer is achieved to the maximum data rate of 11-Gb/s and the average power consumption of 69.43?mW. This circuit is expected to operate at a higher speed than 11-Gb/s in the deep-submicron process of the high operating frequency.     

钟控神经MOS管的改进及其在多值电路中的应用

首先对钟控神经MOS管进行研究,提出了相应的改进方法.然后采用此改进的钟控神经MOS管设计了一种新型多值触发器.与传统的触发器相比较,此多值触发器具有结构简单、速度快、功耗低等特点;而且无需改变电路结构就可实现不同基的多值触发器.PSPICE模拟证明了所设计的电路具有正确的逻辑功能.