静态SAT问题并行处理器的设计研究 |
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引用本文: | 廉德亮,张炜,朱明程. 静态SAT问题并行处理器的设计研究[J]. 深圳大学学报(理工版), 2002, 19(3): 24-30 |
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作者姓名: | 廉德亮 张炜 朱明程 |
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作者单位: | 深圳大学信息工程学院,深圳,518060 |
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基金项目: | 国家自然科学基金资助项目(69976020) |
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摘 要: | 针对SAT问题的复杂性及求解速度缓慢的问题,采用可重构器件FPGA设计,实现了静态回溯搜索算法SAT问题并行处理器,提出了研制动态SAT并行处理器的设想。
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关 键 词: | 静态SAT问题 并行处理器 FPGA 回溯搜索算法 |
文章编号: | 1000-2618(2002)03-0024-07 |
修稿时间: | 2002-06-28 |
The Research on the Design of Static SAT Parallel Processors |
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Abstract: | |
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Keywords: | SAT problem FPGA backtrack search algorithm parallel processor |
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