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基于电感电容振荡器的电荷泵锁相环的设计
引用本文:袁莉,周玉梅,张锋.基于电感电容振荡器的电荷泵锁相环的设计[J].半导体技术,2011,36(6):451-454,473.
作者姓名:袁莉  周玉梅  张锋
作者单位:中国科学院微电子研究所,北京,100029;中国科学院微电子研究所,北京,100029;中国科学院微电子研究所,北京,100029
基金项目:国家重大专项资助项目(2009ZX03007-002-03); 国家自然科学基金资助项目(60801045)
摘    要:设计并实现了一种采用电感电容振荡器的电荷泵锁相环,分析了锁相环中鉴频/鉴相器(PFD)、电荷泵(CP)、环路滤波器(LP)、电感电容压控振荡器(VCO)的电路结构和设计考虑。锁相环芯片采用0.13μm MS&RF CMOS工艺制造。测试结果表明,锁相环锁定的频率为5.6~6.9 GHz。在6.25 GHz时,参考杂散为-51.57 dBc;1 MHz频偏处相位噪声为-98.35 dBc/Hz;10 MHz频偏处相位噪声为-120.3 dBc/Hz;在1.2 V/3.3 V电源电压下,锁相环的功耗为51.6 mW。芯片总面积为1.334 mm2。

关 键 词:锁相环  电感电容振荡器  电荷泵  鉴频鉴相器  环路滤波器

Design of Charge Pump PLL with LC VCO
Yuan Li,Zhou Yumei,Zhang Feng.Design of Charge Pump PLL with LC VCO[J].Semiconductor Technology,2011,36(6):451-454,473.
Authors:Yuan Li  Zhou Yumei  Zhang Feng
Affiliation:Yuan Li,Zhou Yumei,Zhang Feng(Institute of Microelectronics,Chinese Academy of Sciences,Beijing 100029,China)
Abstract:A charge pump phase locked loop(PLL) with LC voltage controlled oscillator(VCO) was presented.The circuit structures of the frequency/phase detector,charge pump,loop filter and LC VCO were analyzed and the design consideration was given.The chip was fabricated in 0.13 μm MS & RF CMOS technology.The test results show that the PLL operates at 5.6-6.9 GHz,and the phase noise of -98.35 dBc/Hz at 1 MHz offset and -120.3 dBc/Hz at 10 MHz offset is achieved.When the frequency is 6.25 GHz,the reference spur is -51.57 dBc.The PLL chip occupies 1.334 mm2,exhibites a power consumption of 51.6 mW at 1.2 V/3.3 V power supply.
Keywords:phase locked loop  LC oscillator  charge pump  frequency/phase detector  loop filter  
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