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高速电路平行互连线时延估算与数值分析
引用本文:李长辉,毛军发,李晓春.高速电路平行互连线时延估算与数值分析[J].微电子学,2004,34(6):648-651.
作者姓名:李长辉  毛军发  李晓春
作者单位:上海交通大学,电子工程系,上海,200030
基金项目:国家自然科学基金(90207010),国家863计划(2002AA1Z1520),上海AM基金(0110)资助。
摘    要:利用数值方法分析了0.25μm工艺条件之下双平行线以及三平行线最坏情况下的时间延迟,得到了考虑驱劝电阻以及终端负载影响的时间延迟简单经验计算公式。该公式比文献上已有公式的适应范围更广,与Hspice精确仿真结果的误差在10%以内。

关 键 词:平行互连线  时问延迟  数值分析
文章编号:1004-3365(2004)06-0648-04

Time Delay Estimation and Data Analysis of Parallel Interconnect Lines in High Speed Circuits
LI Chang-hui,MAO Jun-fa,Li Xiao-chun.Time Delay Estimation and Data Analysis of Parallel Interconnect Lines in High Speed Circuits[J].Microelectronics,2004,34(6):648-651.
Authors:LI Chang-hui  MAO Jun-fa  Li Xiao-chun
Abstract:
Keywords:Parallel interconnect line  Time delay  Numerical analysis
本文献已被 CNKI 维普 万方数据 等数据库收录!
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