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1.
2.4GHz动态CMOS分频器的设计 总被引:1,自引:0,他引:1
对现阶段的主流高速CMOS分频器进行分析和比较,在此基础上设计一种采用TSPC(truesingle phase clock)和E-TSPC(extended TSPC)技术的前置双模分频器电路.该分频器大大提高了工作频率,采用0.6μm CMOS工艺参数进行仿真的结果表明,在5V电源电压下,最高频率达到3GHz,功耗仅为8mW. 相似文献
2.
把大规模集成电路和计算机结合,构成数字处理智能锁相环(DP-PLL)。DP-PLL依靠存贮程序控制获得较好的同步性能,可以抑制很低频率的相位抖动及具有一定抗输入信号扰动的能力,是实现网同步的理想部件。本文主要论述DP-PLL系统的结构、设计方法和实验结果。 相似文献
3.
研究了多径信道下OFDM系统的一种新的载波频率跟踪算法,这种算法以判决反馈和接收端的时域信号重构为基础。推导了估计结果的精确解,比较了使用原估计结果和新的估计结果进行频偏补偿时系统跟踪性能的不同。通过对算法的仔细分析,发现除了通常的加性噪声外,信道估计误差、子载波数目和子载波的调制方式也影响频偏的估计结果和跟踪范围,而且子载波的数目和调制方式是决定性的因素。这种频率跟踪方法的优点是即使在很低的信噪比下仍然能获得高的跟踪精度,且实现相对简单。 相似文献
4.
5.
本文论及非编码MPSK-OFDM系统载波跟踪中的重要部件?判决指导的相位估计器(PED)的研究.多载波系统的相位估计可以表示为各子载波相位估计的加权和.文中在分析单载波的基础上考察了符号判决错误对多载波相位估计的影响,并提出了两种改进方案,一是给出一组新的加权系数,改善了PED在较低信噪比的性能;二是由导频子载波相位估计指导其它数据子载波相位估计,获得了(-(/)M (/)M)区间上的线性无偏估计器.文中对两种改进算法进行了分析比较和仿真验证. 相似文献
6.
高频数字锁相环的研究 总被引:5,自引:0,他引:5
论文阐述了100MHz数字锁相环的设计过程,用10MHz晶体振荡器对100MHz数字压控振荡器进行锁相,使100MHz输出信号指标得到很大改善。论文还分析了各单元电路,关键点时域波形测试,频谱测试。 相似文献
7.
童雅月 《河海大学机械学院学报》1995,9(4):54-59
大规模集成电路和高速数字电路的不断发展,使得频率合成器迅速地被广泛应用。本文就目前无线同中的频率合成器作一个介绍,并注其典型应用给出框图。 相似文献
8.
9.
视频信号分配器电路的研制 总被引:1,自引:0,他引:1
本文阐述了视频信号分配器电路的设计原理,重点介绍了减小视频信号失真的措施与方法,从而提高了图像清晰度。 相似文献
10.
介绍了神经网络与线性分组码之间的关系,并在文献[1]的基础上证明了软判决译码与求解能量函数最大值之间的等价性,然后以(7,4,3)汉明码为例介绍了神经网络在循环码硬判决、软判决译码中的应用。 相似文献