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提出一种新型基于源极跟随器的零极点型滤波器。提出的单支路全差分的双二阶单元采用两个前馈电容综合复数零点,用于实现连续时间零极点型滤波器。源极跟随器在电压域直接处理信号使得该双二阶单元以低功耗实现高线性度。利用CMOS0.18μm工艺级联实现了一个4阶切比雪夫Ⅱ型全差分低通滤波器。测试结果表明,滤波器带宽为2.75MHz,实现了带外下陷特性。在2V电源电压下,消耗电流为1.5mA,测得带内IIP3为5dBm。在三次谐波失真(HD3)为-46.3dB条件下滤波器的动态范围为65dB。 相似文献
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提出了一种带内噪声整形连续时间滤波器,详细分析了滤波器的传输特性和噪声整形原理.采用0.18 μm CMOS工艺,设计了一个4阶巴特沃斯型全差分低通滤波器.仿真结果表明,滤波器的带内增益为10 dB, -3 dB频率为4.5 MHz;输出噪声的理论分析与仿真结果一致;在2.5 V电源电压下,消耗电流为0.8 mA, 带外IIP3为25.3 dBV,带外无杂散动态范围为65.3 dB. 相似文献
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对静态随机存储器(SRAM)全定制设计过程中的版图设计工作量大、重复性强的问题进行了分析,并在此基础上提出了一种新的应用于SRAM设计的快速综合技术。这种技术充分利用SRAM电路重复单元多的特点,在设计过程中尽可能把电路版图的硬件设计转换为使用软件来实现,节省了大量的版图设计和验证的时间,从而提高了工作效率。这种技术在龙芯Ⅱ号CPU的SRAM设计中得到了应用;芯片采用的是中芯国际0.18μm CM O S工艺。流片验证表明,该技术对于大容量的SRAM设计是较为准确而且有效的。 相似文献
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设计了一款工作速率为1.25~3.125 Gb/s的连续可调时钟数据恢复(CDR)电路,可以满足多种通信标准的设计需求.CDR采用相位插值型双环路结构,使系统可以根据应用需求对抖动抑制和相位跟踪能力独立进行优化.针对低功耗和低噪声的需求,提出一种新型半速率采样判决电路,利用电流共享和节点电容充放电技术,数据速率为3.125 Gb/s时,仅需要消耗50 μA电流.芯片采用0.13 μm工艺流片验证,面积0.42 m㎡,功耗98 mw,测试结果表明,时钟数据恢复电路接收PRBS7序列时,误码率小于10-12. 相似文献
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