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目前LDMOS已经广泛应用于功率集成电路和微波集成电路中,建立LDMOS的SPICE等效电路变得很重要.以往的模型都是将LDMOS分为线性区和饱和区两段来分析,公式复杂而且计算量大.因此在数值模拟的基础上提出了全导通区域的伏安特性方程,建立了LDMOS Ⅰ-Ⅴ特性的宏模型.该模型的特点是参数少,易于提取,得到的SPICE等效电路简单,仿真容易收敛. 相似文献
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提出一种SCL结构差分型鉴频鉴相器(PFD),这种鉴频鉴相器能大幅度降低鉴相死区,而且具有噪声低、速度快等优点.这种差分型PFD在高速、低抖动、低噪声PLL中有着广泛的应用.该电路基于chartered 0.35μm CMOS工艺,并用MENTOR eldo进行仿真,仿真结构表明,该PFD死区只有0.03ns.并且可以大大降低VCO控制电压的波纹. 相似文献
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目前LDMOS已经广泛应用于功率集成电路和微波集成电路中,建立LDMOS的SPICE等效电路变得很重要。以往的模型都是将LDMOS分为线性区和饱和区两段来分析,公式复杂而且计算量大。因此在数值模拟的基础上提出了全导通区域的伏安特性方程,建立了LDMOSI-V特性的宏模型。该模型的特点是参数少,易于提取,得到的SPICE等效电路简单,仿真容易收敛。 相似文献
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在分析锁相环基本原理和线性化模型的基础上,给出了基于锁相环系统环路带宽和相位裕度的环路滤波器参数的计算公式.结合具体的参数计算,给出系统参数,然后用ADS工具对系统进行仿真,结果表明利用给出的方法来设定锁相环的参数,通过反复几次的调节能得到一组很好的系统参数,仿真结果于预期的相吻合,对三阶电荷泵锁相环的系统设计和仿真有一定的指导意义. 相似文献