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研究实施库、淀联合调度,是在保证防洪安全的前提下,科学利用雨洪资源,降低洪灾损失的有效措施。本文针对保定市实际情况.论述库、淀联合调度的可行性和必要性,提出实现库、淀联合调度的建议。 相似文献
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本文提出了一个新的门与功能块级逻辑模拟和延迟时间分析系统GFSAS-1。GFSAS-1的结构是一个以数据库为中心的模块结构。本文简要介绍了GFSAS-1的系统组成和功能特点,重点阐述了数据库管理系统(DMS),主要功能模块,以及波形描述语言(WDL)的设计方案 相似文献
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介绍了企业园区计算机网安全管理系统的基本构成,并对园区网络管理系统的安全防范现状和网络安全的隐患进行了分析。通过结合某企业园区网实际安全防范的实施策略,论述了企业园区计算机网管理系统常用的安全防御方法。 相似文献
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面向基于平台的SoC设计方法,本文提出约束任务流图模型(CTG)作为SoC系统模型,提出了基于平台的CTG SoC系统建模方法,实现了SoC系统建模环境CPSME。CTG模型是一种可变粒度的SoC系统模型,可同时描述系统任务的功能和性能。本文基于平台的CTG SoC系统建模方法支持CTG模型的系统级重用与定制,有效提高了系统建模效率。在CPSME环境下进行MP3播放器和MPEG2播放器的SoC系统建模实践表明,新方法的模型重用率可达到75%~90%。 相似文献
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采用金相显微镜、XRD物相分析、透射电镜观察和力学性能测试,研究了真空感应熔炼水冷铜模铸造下Al-8.2Zn-2.05Mg(10Zn-2.5Mg,12Zn-3Mg)-2.2Cu-0.1Mn-0.25Zr合金析出相的强化效应,以及第1种合金在形变热处理工艺下引入的亚晶强化效应.结果表明,3种合金在T6(120℃时效24 h)状态下均析出了均匀弥散的强化相η’,此时析出相强化起主导作用.随着Zn、Mg含量的提高,析出强化相的数量逐渐增多,析出相强化效应增大,3种合金的抗拉强度分别为646.2、697.4和732.5MPa,伸长率分别为13.0%、10.6%和7.1%,抗拉强度与其析出相强化效应对应;采用120℃预时效12 h+120℃温变形30%+120℃终时效10 h的形变热处理工艺可使Al-8.2Zn-2.05Mg-2.2Cu-0.1Mn-0.25Zr合金获得亚晶组织,此时合金为亚晶强化与析出相强化共同作用的强化机制,合金的抗拉强度达到752.3MPa,伸长率为6.7%;亚晶内析出均匀弥散强化相提高合金性能,比单一增加析出相数量效果更好. 相似文献
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指出了我国现行高速公路隧道设计中采用的围岩分级方法的缺陷,提出在施工阶段通过对隧道围岩进行勘探和测试,并对其结果进行综合分析,在此基础上对隧道围岩进行动态分级,并以广贺高速公路文坑隧道YK73+830断面为例,通过对其掌子面处围岩进行地质雷达探测、点荷载试验和声波测试,结果表明实际的围岩级别与设计阶段的不符,从而对其进行调整。 相似文献
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研究了7种亚快速凝固Mg-Zn-Sn-Al-Ca合金的组织、拉伸性能和抗蠕变性能。对于Mg-xZn-ySn-2Al-0.2Ca(x+y=9,x/y为2,1和0.5)合金,锌锡比为1时室温抗拉强度和屈服强度最高:150℃屈服强度随着锌锡比的增加而提高,而200℃相反。这可能与低锌锡比合金中Mg_2Sn较多、含Zn化合物较少且Mg_2Sn具有高温强化作用有关。对于Mg-4.5Zn-4.5Sn-2Al-zCa(z=0,0.2,0.4,0.6)合金,室温和200℃抗拉强度和屈服强度随着Ca含量的增加先提高后下降,峰值分别出现在0.2%Ca和0.4%Ca。200℃/50MPa压缩蠕变时,合金初始应变量和稳态蠕变速率随着Ca含量的增加而降低。少量Ca可以提高Mg-4.5Zn-4.5Sn-2Al合金的室温和高温强度并改善抗蠕变性能,但降低高温塑性。此外,也影响拉伸断裂模式。随着Ca含量的增加,合金室温断裂由解理断裂转变为准解理断裂,200℃断裂由韧性断裂转变为准解理断裂。 相似文献
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A radiation-hardened-by-design (RHBD) technique for phase-locked loops (PLLs) has been developed for single-event transient (SET) mitigation. By presenting a novel SET-resistant complementary current limiter (CCL) and implementing it between the charge pump (CP) and the loop filter (LPF), the PLL's single-event susceptibility is significantly decreased in the presence of SETs in CPs, whereas it has little impact on the loop parameters in the absence of SETs in CPs. Transistor-level simulation results show that the CCL circuit can significantly reduce the voltage perturbation on the input of the voltage-controlled oscillator (VCO) by up to 93.1% and reduce the recovery time of the PLL by up to 79.0%. Moreover, the CCL circuit can also accelerate the PLL recovery procedure from loss of lock due to phase or frequency shift, as well as a single-event strike. 相似文献