一种高速近似乘法器设计

近似计算作为一种有效权衡精度与性能的新型计算方式,已被广泛运用于图像处理、数据挖掘和多媒体技术等能够容忍少量计算错误的相关应用中,然而此类应用存在大量乘法操作。为加快数据处理速度,设计一种新型的近似乘法器,采用近似加法实现部分累加运算,从而减少近似乘法器的资源消耗,同时通过流水线结构增加系统的时钟频率,进而提高数据吞吐率。统计结果表明,与精确乘法器相比,该设计可节省32.2%的查找表资源。在图像处理应用中,相较AMA、UDM等近似乘法器,该设计的峰值信噪比较高,图像重构的效果较好。     

SRAM型FPGA的可重构容错结构研究

针对SRAM型FPGA,提出了一种基于动态可重构技术的容错设计方法,根据瞬态错误概率的高低来动态控制系统的冗余程度。在错误率低的时候,系统采用双备份比较（DWC）,具有较低的面积开销和功耗;在错误率高的时候,系统切换到三模冗余（TMR）排除单个错误的影响。采用基于代理逻辑（Proxy LUT）和早期获取部分可重构(EAPR)的设计方法,以ISCAS’85 benchmark电路中的大型代表电路为验证模块,叙述了动态可重构的容错结构的实现过程,并重点验证了动态可重构容错设计方法和其它静态容错方法相比,在面积和功耗上的优势,结果表明动态可重构容错结构相比混合容错结构而言,其面积开销和功率消耗较小。     

基于软件无线电的ADS-B信号接收机设计

为了及时获取航迹信息,基于射频前端芯片AD9361以及基带数据处理芯片Zynq-7000设计了一种对广播式自动相关监视(Automatic Dependent Surveillance-Broadcast,ADS-B)信号解调的软件无线电接收系统,给出详尽的硬件框架设计,进行了Linux平台搭建,并完成了AD9361寄...