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在2.5V电源电压下采用中芯国际(SMIC)0.25μm混合信号CMOS工艺设计了一个单级全差分运算放大器。所设计的运放采用了增益提升技术,其主运放为一个带有开关电容共模反馈的全差分折叠一共源共栅运放。两个带有连续时间共模反馈的全差分折叠一共源共栅运放作为辅运放用来提升主运放的开环增益。此外,本文还提出了一种可用于增益提升运放高速设计的基于仿真的优化方法。仿真结果表明,所设计运放的直流增益可达102dB,单位增益频率为822MHz,通过高速优化,其达到0.1%精度的建立时间为4ns。 相似文献
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一种新型异步数据通路性能分析方法 总被引:1,自引:0,他引:1
介绍了一种新型的异步数据通路性能分析方法。这种方法在进行性能分析时基于多延迟模型、SPICE和逻辑仿真 ,可以作为异步数据通路设计和分析的一种有效工具。为了进一步的阐述和验证这种分析方法 ,文中举例分析了 4比特和 8比特异步比较器。 相似文献
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