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工业技术 | 130篇 |
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分析了不同机型生产α淀粉的优缺点,阐述了α化机理;采用二次回归旋转通用组合设计的试验方法,得出了不同的因素水平对α淀粉特性的制约程度,与因素适宜的选取范围,为生产实践提供理论根据。 相似文献
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本文介绍了一个10位50MS/s无需基准源的低功耗逐次逼近型模数转换器。设计中采用了一种高能效的开关方案。该开关方案使得模数转换器无需额外的模拟电压或者片上/片外基准电压源就能获得低功耗以及良好的高速操作性能。设计中利用片上校准数模转换器来对Latch型的灵敏放大器进行校准,消除失调电压并且去除对前置放大器的依赖性。该设计利用IBM 0.18-μm 1P4M SOI/CMOS工艺实现。该逐次逼近型模数转换器在1.5V电源电压,5MHz的输入频率以及50MS/s采样速率条件下,能够获得56.76 dB SNDR,此时功耗为1.72 mW, 从而取得FOM值为61.1 fJ/conversion-step。 相似文献
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以利乐枕在装箱过程中的输送系统为研究对象,为实现装箱系统与灌装线系统在速度方面相匹配,提出了双线输送系统,并对输送系统中的关键结构伸缩皮带作了功能分析与参数分析. 相似文献
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正A 10-bit 50-MS/s reference-free low power successive approximation register(SAR) analog-to-digital converter(ADC) is presented.An energy efficient switching scheme is utilized in this design to obtain low power and high frequency operation performance without an additional analog power supply or on-chip/off-chip reference. An on-chip calibration DAC(CDAC) is implemented to cancel the offset of the latch-type sense amplifier(SA) to ensure precision whilst getting rid of the dependence on the pre-amplifier,so that the power consumption can be reduced further.The design was fabricated in IBM 0.18-μm 1P4M SOI CMOS process technology.At a 1.5-V supply and 50-MS/s with 5-MHz input,the ADC achieves an SNDR of 56.76 dB and consumes 1.72 mW,resulting in a figure of merit(FOM) of 61.1 fJ/conversion-step. 相似文献
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