中小屏幕TFT-LCD驱动芯片的输出缓冲电路

在分析中小屏幕TFT-LCD驱动芯片的负荷特性的基础上,提出了一种新型的驱动电压输出缓冲电路结构.通过负反馈动态控制输出级的工作状态,具有交替提供拉电流和灌电流的驱动能力,可有效抑制输出电压的波动.与传统的两级运算放大器电路相比,该电路结构简单,稳定性能好,降低了静态功耗并节省了芯片面积.采用0.25μm CMOS工艺设计并实现了两种不同输出电压的缓冲电路.HSPICE仿真结果表明,输出电压缓冲电路的静态电流为3μA,Offset电压小于±2mV.同时,当TFT-LCD的驱动电压在-8～ 16V之间切换时,输出电压的波动范围小于±0.4V,输出电压的恢复时间小于7μs.经对工程样片的测试知,其性能完全满足中小屏幕TFT-LCD驱动控制芯片的要求.     

中小屏幕TFT-LCD驱动芯片的输出缓冲电路

在分析中小屏幕TFT-LCD驱动芯片的负荷特性的基础上,提出了一种新型的驱动电压输出缓冲电路结构.通过负反馈动态控制输出级的工作状态,具有交替提供拉电流和灌电流的驱动能力,可有效抑制输出电压的波动.与传统的两级运算放大器电路相比,该电路结构简单,稳定性能好,降低了静态功耗并节省了芯片面积.采用0.25μm CMOS工艺设计并实现了两种不同输出电压的缓冲电路.HSPICE仿真结果表明,输出电压缓冲电路的静态电流为3μA,Offset电压小于±2mV.同时,当TFT-LCD的驱动电压在-8～+16V之间切换时,输出电压的波动范围小于±0.4V,输出电压的恢复时间小于7μs.经对工程样片的测试知,其性能完全满足中小屏幕TFT-LCD驱动控制芯片的要求.     

42V、2μA I_Q低压差开关电源

530mV最大压差LT3973是我们不断成长的超低静态电流高电压单片式降压型稳压器系列的最新成员。该器件仅消耗1.8μA静态电流,并可从12V输入提供3.3V稳压输出。在芯片上内置了一个高效率开关以及箝位二极管、升压二极管和所有必需的控制器和逻辑电路。当输入电压降至编程输出电压以下时,可保持一个530mV的最小压差电压,从而为下游负载提供一个稳定的输出。其低纹波突发模     

一种用于无源射频识别标签的上电复位电路

提出了一种新型的低压低功耗上电复位电路。该电路利用MOS管多种二级效应,采用多种低压低功耗技术,满足降低功耗的需要。整个上电复位电路的静态功耗低于1μW,应用于1.8 V与1.2 V电源电压。设计采用SMIC 0.18μm EEPROM工艺,可应用于其他低电源电压以及低功耗要求的芯片设计。     

重影消除自适应均衡芯片设计

提出了一种重影消除自适应均衡芯片设计．该芯片采用自适应算法、内置576抽头数字滤波器，可完成重影消除的所有功能。芯片高度集成，内嵌DSP控制器、存储器、同步检测器、D／A、A／D及用户编程。该芯片采用3．3V电源电压、0．35μm CMOS工艺生产制造，80-pin的QFP封装；在典型工作频率下最大功耗为1．3W。     

一种基于BCD工艺的汽车电压调节器芯片设计

针对目前车用电压调节器体积大、稳定性差和寿命短等问题,设计了一款用于汽车的电压调节器芯片。该芯片通过PWM技术调整发电机励磁绕组的平均励磁电流,稳定了发电机输出电压。同时,该芯片集成了低温漂、高精度的电压基准源与电流源,还具有欠压锁定与过温保护电路,提高了系统可靠性。芯片基于0.5 μm BCD工艺进行设计,采用Cadence Spectre进行仿真。仿真结果表明,该芯片工作电压是720 V,静态电流仅为472 μA,电压调节范围1020 V,基准电压1.16 V,工作温度范围-40125 ℃,温度系数8.4 ppm·℃ ^-1,且当发电机输出电压波动时,该芯片可使输出电压稳定。     

一种新的相位开关实现技术及其在射频双模预分频器中的应用

提出了一种新的相位开关实现技术.基于这种技术设计了一个2/3分频器单元,该单元结构简单,工作频率高,功耗低.为了验证该技术,采用0.25μm CMOS数字工艺实现了一个128/129双模预分频器.对该芯片的测试结果表明其能正确工作于GHz频率范围.当工作频率为2.3GHz时,它消耗的电流仅为13.5mA(2.5V电源电压),芯片面积为0.47mm×0.47mm.     

低输入高效率高可调性DC/DC转换器的设计

设计了一种基于0.6 μm BiCMOS工艺的低功耗、微功率、低输入、高输出、高效率、高可调性PFM升压型DC/DC转换芯片.分别采用高低压结合、预充电和抗饱和、固定关闭时间电流模式控制结构以达到低工作电压、高效率、高可调性和稳定的电压输出.本芯片采用XFAB公司的XB06工艺流片成功.测试结果表明,芯片的工作电压可低至1 V,无负载时静态电流仅为20μA,在输入电压/负载电流分别为1.5 V/15 mA、6 V/500μA的情况下能稳定地输出3.3、35 V,最高转换效率可达85%.     

一种低功耗的13位100MS／s采样保持电路

采用TSMC0．18μm 1P6MCMOS工艺设计了一种高性能低功耗采样保持电路。该电路采用全差分折叠增益自举运算放大器和栅压自举开关实现。在3．3V电源电压下,该电路静态功耗仅为16．6mw。在100MHz采样频率时,输入信号在奈奎斯特频率下该电路能达到91dB的SFDR,其有效精度可以达到13位。     

一种低功耗亚阈值全MOS管基准电压源的设计

分析了工作在亚阈值区、线性区和饱和区的MOS晶体管不同电流特性,设计了一种低功耗全MOS基准电压源电路。使用工作在线性区的MOS晶体管代替普通常规电阻,使整个电路实现全MOS基准源的特性,同时有效减小电路芯片面积,并且输出基准电压为线性区MOS管提供偏压以进一步降低功耗。基于SMIC 0.18μm CMOS工艺设计电路。仿真结果表明此电路在1.8 V电源电压下,–50~+150℃的温度系数为22.6×10–6/℃,基准电压源输出电压约为992 m V,25℃时静态电流为327.3 n A,电路总静态功耗为0.59μW,10 k Hz时的电源抑制比为–25.36 d B。     

Digitally controlled CMOS current follower for low voltage lowpower applications

A novel digitally controlled CMOS current follower is proposed. The circuit is useful for low voltage low power high frequency applications. The DCCF operates from a 3 V supply in class AB mode and provides precise digitally programmable current gain without component spread. Experimental results from a 1.2 μm CMOS chip fabricated through MOSIS are provided     

两种低功耗新型过温保护电路的设计

电源管理芯片中过温保护电路用来检测芯片的温度。当温度过高时,过温保护电路输出保护信号,使芯片停止工作,以免温度过高而损坏芯片。为了实现上述过温保护电路功能,提出了两种新型的过温保护电路,不但能够精确地检测芯片的温度,并且功耗很低。采用0．5μm N-阱CMOS工艺的方法,进行电路设计,并使用CadenceSpectre工具进行了仿真实验验证。仿真实验结果表明两种电路仅消耗3μA的电流就能够实现精确的温度检测,其具有较强的适应性,高灵敏度和高精度的特点,应用前景比较广泛。     

A 4-Mbit CMOS EPROM

A high-density (512K-word/spl times/8-b) erasable programmable read-only memory (EPROM) has been designed and fabricated by using 0.8-/spl mu/m n-well CMOS technology. A novel chip layout and a sense-amplifier circuit produce a 120-ns access time and a 4-mA operational supply current. The interpoly dielectric, composed of a triple-layer structure, realizes a 10-/spl mu/s/byte fast programming time, in spite of scaling the programming voltage V/SUB PP/ from 12.5 V for a 1-Mb EPROM to 10.5 V for this 4-Mb EPROM. To meet the increasing demand for a one-time programmable (OTP) ROM, a circuit is implemented to monitor the access time after the assembly. A novel redundancy scheme is incorporated to reduce additional tests after the laser fuse programming. Cell size and chip size are 3.1/spl times/2.9 /spl mu/m/SUP 2/ and 5.86/spl times/14.92 mm/SUP 2/, respectively.     

同步降压DC-DC转换器驱动级设计

提出一种输入电压为4.5～23 V、输出电流可达3A的同步降压转换器的驱动级,内部集成了电平移位、死区时间控制及同步管反向电流限制等功能.设计了一种为内部逻辑供电的低压电源,使驱动级大部分可以由低压器件构成,与外部电源供电的驱动级相比,大大减小了芯片面积.分析了该电路的结构与工作原理;采用0.6 μm BCD工艺,通过HSPICE进行仿真,证明该驱动级方案切实可行.     

一种启动电流为0的CMOS低功耗低成本电流源

根据传统电流源结构,设计了一种启动电流为0的CMOS低功耗电流源。电流源的启动电路仅采用一个耗尽型MOS管,电路正常工作后启动电路会自动关断。仿真结果显示电路正常工作后启动部分消耗的电流基本降为0,整个电路功耗24．9μW。这种结构降低了整个电路的功耗,大大节省了芯片面积。电路基于TSMC0．18μm CMOS工艺,电源电压1．8V,仿真软件为Hspice。     

一种射频可编程N分频器的设计

提出了用射频CML技术设计的2/3分频单元.基于2/3分频单元,使用0.35 μm SiGeBiCMOS工艺,实现了射频可编程N分频器.验证结果表明,电路可在GHz频率下正常工作,具有相噪低、功耗小等特点.在3 GHz射频输入信号频率下,频偏100 kHz的输出相位噪声为-143dBc/Hz.电路消耗的总电流仅为4 mA(3 V单电源电压),功耗仅为12 mW.     

Programmable CMOS current comparator circuit for analogue VLSI neural networks utilizing identical small-dimension MOS transistors†

A programmable CMOS current comparator circuit is presented which employs seven identical small-dimension MOS transistors, and whose threshold current is adjustable without the need to change any of the MOS transistors. Using transistors with W/L of 2/0.6 um and a 5 V supply voltage, the comparator can be programmed to detect currents over the range from 50 nA to 550 μA. With W/L of 3/0.6 μm and a 3.3 V supply voltage, the programmable range is from 20 nA to 365 μA. Simulations for these configurations indicate that the circuit has propagation delays of 4.125 ns and 4-08 ns, respectively.     

A 5-GHz programmable frequency divider in 0.18-μM CMOS technology

A 5-GHz CMOS programmable frequency divider whose modulus can be varied from 2403 to 2480 for 2.4-GHz ZigBee applications is presented.The divider based on a dual-modulus prescaler (DMP) and pulse-swallow counter is designed to reduce power consumption and chip area.Implemented in the 0.18-μm mixed-signal CMOS process,the divider operates over a wide range of 1-7.4 GHz with an input signal of 7.5 dBm; the programmable divider output phase noise is -125.3 dBc/Hz at an offset of 100 kHz.The core circuit without test buffer consumes 4.3 mA current from a 1.8 V power supply and occupies a chip area of approximately 0.015 mm2.The experimental results indicate that the programmable divider works well for its application in frequency synthesizers.     

A high efficiency charge pump circuit for low power applications

A high efficiency charge pump circuit is designed and realized. The charge transfer switch is biased by the additional capacitor and transistor to eliminate the influence of the threshold voltage. Moreover, the bulk of the switch transistor is dynamically biased so that the threshold voltage gets lower when it is turned on during charge transfer and gets higher when it is turned off. As a result, the efficiency of the charge pump circuit can be improved. A test chip has been implemented in a 0.18 μm 3.3 V standard CMOS process. The measured output voltage of the eight-pumping-stage charge pump is 9.8 V with each pumping capacitor of 0.5 pF at an output current of 0.18 μA, when the clock frequency is 780 kHz and the supply voltage is 2 V. The charge pump and the clock driver consume a total current of 2.9 μA from the power supply. This circuit is suitable for low power applications.     

一种基于数字逻辑控制的低损耗双半桥驱动芯片

设计了一种集成双半桥和四功率开关的驱动芯片。采用双路对称设计,每一路可单独控制使能、自举和驱动。芯片内部采用高精度的基准源以及LDO电路,同时具有欠压死锁、过压保护和过温保护功能。死区控制可避免上下功率管直通大电流,自举设计可使上功率管的开启电压达到5 V,降低了功率管自身的损耗,使功率管输出达到11.90 V。采用TSMC 0.18μm BCD工艺进行流片。测试结果表明,输出的方波信号幅度为11.96 V/11.95 V,死区时间为60 ns/80 ns,静态功耗低至478μA。