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随着集成电路规模越来越大,设计变得越来越复杂.为了有效地提升设计生产率,芯片敏捷设计受到越来越广泛的重视.在芯片RTL-to-GDSII设计流程中,敏捷设计方法需要广泛借助机器学习技术,寻求“无人参与”的解决方案.时序性能作为芯片的重要性能指标,需要在RTL-to-GDSII设计的各个流程中进行静态时序分析.快速、准确、可靠的时序预测,可以将Sign-Off的时序性能前馈到早期设计流程中,指导早期设计的时序优化和时序收敛,减少芯片设计的迭代次数和迭代周期.文中给出敏捷设计中时序优化的流程框架,详细地梳理了RTL-to-GDSII设计流程中基于机器学习的时序分析研究现状;并从数据准备、问题建模、实用性以及通用性等多方面,探讨了敏捷设计中基于机器学习方法进行时序预测的挑战. 相似文献
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对敏捷制造和敏捷企业领域、敏捷软件开发和敏捷项目管理领域的国内外相关敏捷性理论进行研究,总结工业设计领域可借鉴的敏捷理论。文章通过分析工业设计的不确定性因素,探讨工业设计的敏捷性特征,进而概括敏捷工业设计方法的基本原则为以自组织团队为组织形式,以轻量级实践为设计方法,以适应式过程为设计流程,以期从敏捷性角度为工业设计实践提供方法参考。 相似文献
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本文介绍32位微处理器芯片的行为设计和行为模拟。按照自顶向下的设计原则,在芯片的上层设计阶段,采用了标准的硬件描述语言VHDL建立了该芯片的行为模型,并以此为基础建立了该芯片的行为级虚拟机环境。通过对该虚拟机的调试,完成了该芯片内部组织结构和微程序的正确性验证。 相似文献
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高性能微处理器设计技术 总被引:1,自引:0,他引:1
最近几年,微处理器设计技术迅速发展,高性能微处理器已经成为当代各类计算机系统的主要支柱。本文首先简要回顾微处理器的发展过程,然后着重介绍微处理器的设计技术,接着概述微处理器的应用,最后介绍国内情况并提出几点看法。 相似文献
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VLIW体系结构微处理器的一种设计方法 总被引:1,自引:0,他引:1
微处理器体系结构的发展经历了三个不同的阶段,以Intel早期X86产品为代表的CISC体系结构微处理器;以MIPS、PA-RISC、SPARC、ALPHA、PowerPC等为代表的RISC体系结构微处理器;以Intel近期产品为代表的CISC—RISC混合型体系结构微处理器。RISC和CISC由于其实现技术的复杂性,逐步退 相似文献
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基于中国科学院资源规划(Academia Resource Planning,简称ARP)项目建设,阐述针对科学院院所两级管理情况下,将服务、科研、管理信息化,集成人、财、物、项目以及多种资源共享并能够对高层领导支持决策分析的复杂管理信息系统-ARP 系统。此系统包含十大应用系统和三大建设支撑平台。以国际合作系统开发设计为例,为能快速响应由管理变革带来的需求变更,采用基于敏捷技术平台的开发方法建设业务系统,并实时响应用户。应用效果表明,该方法建设的系统极大的提高了工作效率,提升了院管理信息化水平。 相似文献
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目前液体物料的装卸料操作主要是通过手工操作来实现,劳动强度大且安全性差,介绍一种将微处理器用于液体物料智能卸料控制的技术方法;该方法由微控制器及相应控制软件、液体物理量检测装置、液体流量检测装置、气动阀门以及安全防护措施构成,并在运输过程中进行实时监测储存罐体内的压力和温度,一旦超出限制值立即报警,控制软件依据有限状态自动机原理进行模块设计,易于修改、调试和维护;系统经测试可方便、准确、快速及安全地实现液体物料智能装卸和油量计量。 相似文献
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面向协同产品商务的敏捷设计支持系统的研究 总被引:5,自引:0,他引:5
叙述了协同产品商务(CPC)出现的背景,对CPC定义作了进一步解释,阐明CPC所具有的三个特点及其内涵.将CPC引入产品协同设计,提出产品敏捷设计的概念.构造了面向CPC的产品敏捷设计支持系统,说明了该系统的功能及体系结构,以递纸机构设计为例验证了系统应用. 相似文献
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CPU“软核”可以根据实际应用需要进行剪裁,因而CPU软核设计是soC设计实现的重要部分.在FPGA内部设计和调试完全嵌入式的整数微处理器软核,不仅涉及到通常CPU必需的算术逻辑累加器、寄存器堆、指令缓冲、跳转计数、指令集及指令编译等方面的设计实现,还要针对FPGA内部的结构特点对设计进行分析优化,例如流水线结构的选择、关键路径延迟的折衷平衡以及整体调试等.在Virtex1000FG680-4FPGA上设计实现的32位RISC整数微处理器,运行时钟频率可达30MHz,实现150条指令,占用FPGA逻辑资源7%. 相似文献
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可自适应变频嵌入式微处理器核的设计 总被引:2,自引:0,他引:2
变频技术是一种非常实用的低功耗设计技术.本文设计了与MIPS32—4Kec指令兼容的嵌入式微处理器核SRISC—I,并内嵌锁相环(PLL)作为时钟发生电路,该微处理器核在软件控制下可自适应地改变工作频率.除正常的工作模式外,SRISC—I还支持空闲、体眠模式,可停止整个系统时钟及PLL的运行,有效地降低了功耗.仿真结果表明,在0.1SumCMOS工艺下,SRISCI最高频率达到250MHz,在PLL的控制下其工作频率可以以10MHz的步长改变.同时,给出了SRISC—I在不同频率下运行Dhrystone2.1程序的功耗,250MHz时为82.466m Watt,而在体眠模式下仅为28uWatt. 相似文献
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嵌入式微处理器的可测性设计技术研究 总被引:1,自引:0,他引:1
文章介绍了一个嵌入式微处理器的可测性设计技术。根据嵌入式微处理器各个组成部件逻辑功能的特点,分别采用了内置自测试(BIST)、部分扫描(PartialScan)、边界扫描(BoundaryScan)等方法完成各个部件的可测性设计,并将符合IEEE1149.1的TAP控制器作为整个微处理器的测试控制器,达到了较优的可测性设计结果。 相似文献
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随着电子技术和计算机技术的迅速发展,电子设计也变得越来越复杂,并朝着自动化方向发展,且运用语言进行电子设计成为了一种趋势,有效地缩短了开发的周期及效率,其中VHDL语言就是电子设计中常用的一种语言。本文就VHDL语言在电子设计自动化中的应用进行了分析讨论。 相似文献