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一种基于FPGA的FFT阵列处理器 总被引:7,自引:0,他引:7
提出一种新的FFT信号处理器的实现方法,使用抽取算法在基于FPGA的FFT硬件处理IP上实现并行大点数快速傅立叶变换,由于采用专用FFT硬件处理与DSP相结合的处理结构,使处理速度大幅度提高。理论和仿真分析论证了该方法的有效性。 相似文献
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由FFT芯片构成的并行FFT结构 总被引:1,自引:0,他引:1
快速傅立叶变换(FFT)在计算机层析影象技术,语间识别,图像处理等域得了广泛的应用。随着计算机应用的发展,越来越需要对大规模的数据进行变换。并行FFT是完成快速数据变换的一种方法。本文提出一咱由小规模FFT芯片构成并行FFT的方法,楞用于大规模数据的变换,并对其并行结构的面积和执行时间进行了探讨,还提出了具有容错功能的并行FFT网络。 相似文献
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一种新结构FFT算法及其FPGA实现 总被引:2,自引:0,他引:2
本文给出了一种面向FPGA实现的新结构FFT算法,并利用FPGA器件内部丰富的逻辑单元,RAM、ROM和DSP块实现了FFT核心运算的并行化,与利用传统结构实现的FFT相比大大提高了FFT的运算速度,与用DSP实现的FFT相比速度也要快得多。 相似文献
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为了提高快速傅里叶变换(FFT)处理数据的实时性,本文利用现场可编程阵列(FPGA)逻辑资源丰富、运算速度快的特点以及FFT算法的分级特性,实现了高速、高阶FFT的流水线工作方式设计。通过本文介绍的设计方法,在Xilinx公司Virtex-II系列FPGA上实现了工作频率50MHz以上、数据流水输入、输出的1 024点按时间抽取FFT。 相似文献
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一种基于SIMD-MCC计算机的二维FFT并行算法 总被引:5,自引:5,他引:0
FFT是图像处理中最重要的全局算子之一。文章以SIMD-MCC并行计算机为模型,讨论了二维FFT的并行实现问题,同时给出了相应的并行算法。该算法利用处理元的局部存储器,可在K×K的阵列上处理M×M的图像(M>K),较好的解决了在固定规模阵列上对大尺寸图像进行处理的问题。通过对算法的性能分析表明本算法是可行和高效的。 相似文献
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在FPGA上实现Hvr算法可以充分利用FPGA设计的灵活性和快速性,适合高速数字信号处理。提出了一种利用Altera公司提供的MegaCore开发H可模块的方法,并在FLEX10K系列的FPGA上予以实现,给出了设计框图和仿真波形,并对实现原理进行了详细说明。仿真和应用表明,此模块运算速度快,精度高,工作稳定,且设计成本低。 相似文献
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应用FPGA技术实现FFT 总被引:2,自引:0,他引:2
介绍了应用FPGA技术实现FFT的方法,它既有DSP器件的灵活性,又有专用FFT芯片的快速性,可以广泛地应用于信号处理的各个领域。 相似文献
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一种基于FPGA的高性能FFT处理器设计 总被引:1,自引:0,他引:1
FFT算法是高速实时信号处理的关键算法之一,在数字EW接收机中有着广泛的应用前景。本文基于Xilinx公司的Vertex-IIPro系列FPGA,设计一种级联结构的1024点FFT处理器,采用基-4并行蝶算单元,能并行处理四路输入数据,极大地提高了FFT的处理速度。在系统时钟为100MHz时,完成1024点复数FFT运算仅需要2.56μs。 相似文献
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本文介绍了一种基于FPGA的1024点自定义26位浮点FFT处理器的设计。详细阐述了FFT处理器的自定义浮点格式、算法的选择、浮点乘法加法和FFT中的地址产生规律、存储器的选择等关键技术。最后给出了ISE环境下的仿真结果,验证了设计的正确性,工作频率达到171.136MHz。 相似文献
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介绍了一种基于FPGA的FFT算法的实现——以Altera公司的FLEX10K系列产品为硬件平台,用VHDL语言和电路图完成系统设计描述,用MAX plusⅡ软件进行编译、综合和下载,实现了6点实序列DFT算法,并给出了仿真测试的结果。在FPGA芯片上运行的FFT算法具有速度快且抗干扰能力强的硬件实现的优点,用VHDL语言实现的基于IP核FFT算法具有很好的可移植性,可以重复使用,大大提高了设计效率。 相似文献
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基于FPGA的FFT/IFFT处理器的实现 总被引:1,自引:0,他引:1
提出一种利用并行算法来实现FFT(快速傅里叶变换)及其逆变换IFFT(快速傅里叶逆变换)的设计方法。该处理器可由用户动态配置成64、256、1024点复数FFT或其逆变换IFFT。 相似文献
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介绍一种由高速数字信号处理器(DSP)ADSP TS101实现的雷达数字信号处理机。作为雷达信号处理系统的一部分,主要利用快速傅里叶变换(FFT)算法完成雷达回波中各距离单元内运动目标的积累检测,另外还包括恒虚警处理。系统在设计中较好地利用了DSP芯片的内部资源,充分发挥了DSP芯片的性能,实现高速实时处理,达到较好的系统性能。 相似文献
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基于CORDIC的一种高速实时定点FFT的FPGA实现 总被引:10,自引:1,他引:9
本文论述了一种利用CORDIC算法在FPGA上实现高速实时定点FFF的设计方案。利用CORDIC算法来实现复数乘法,与使用乘法器相比降低了系统的资源占用率,提高了系统速度[1]。设计基于基4时序抽取FFT算法,采用双端口内置RAM和流水线串行工作方式。本设计针对256点、24位长数据进行运算,在XilnxSpartan2E系列的xc2s300e器件下载验证通过,完成一次运算约为12μs,可运用于高速DSP、数字签名算法等对速度要求高的领域。 相似文献