| VHDL设计中电路简化问题的探讨 |
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| 引用本文： | 许春香,雷钢.VHDL设计中电路简化问题的探讨[J].河南教育学院学报(自然科学版),2005,14(4):25-27. |
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| 作者姓名： | 许春香 雷钢 |
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| 作者单位： | 中州大学,工程技术学院,河南,郑州,450005 |
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| 摘 要： | 从描述方法、设计规则、逻辑函数分析了VHDL设计中容易引起电路复杂化的原因，并提出了相应的解决方法。
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| 关 键 词： | VHDL设计 电路简化 设计规则 |
| 文章编号： | 1007-0834(2005)04-0025-03 |
| 收稿时间： | 2005-10-07 |
| 修稿时间： | 2005年10月7日 |
The Inquiry into the Problem of Circuit Simplification in VHDL Design |
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| XU Chun-xiang,LEI Gang.The Inquiry into the Problem of Circuit Simplification in VHDL Design[J].Journal of Henan Education Institute(Natural Science Edition),2005,14(4):25-27. |
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| Authors: | XU Chun-xiang LEI Gang |
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| Affiliation: | College of Engineering and Technology, Zhengzhou University, Zhengzhou 450005, China |
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| Abstract: | |
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| Keywords: | VHDL design circuit simplification design roles |
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