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伪码测距中码跟踪环的设计与实现 总被引:1,自引:0,他引:1
码跟踪环的设计是伪码测距系统的一个关键环节,其参数的选择对环路跟踪曲线影响很大。从分析环路特性的角度出发,详细阐述了环路的设计方法,给出了实际的参考与测试结果,这对于跟踪环的工程实践具有一定的参考价值。 相似文献
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