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一种基于FPGA的图像中值滤波器的硬件实现 总被引:15,自引:0,他引:15
随着超大规模集成电路 (VLSI)技术的不断发展 ,图像的并行处理技术也得到飞速发展。现场可编程门阵列 (FPGA)是在专用集成电路 (ASIC)的基础上发展起来的一种可动态编程的器件 ,与其他中小规模集成电路相比 ,其优点主要在于它有很强的灵活性 ,即其内部的具体逻辑功能可以根据需要配置 ,对电路的修改和维护很方便 ,设计周期短 ,可重构 ,扩展性好等 ,特别适用于流水线方式的数据处理。文中以XILINX公司的XVC30 0 5BG35 2型FPGA芯片为平台构建图像中值滤波实时处理模块 ,并成功地实现了对一帧 1 2 8× 1 2 8× 8像素的灰度图像的滤波处理。 相似文献
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小波提升算法是一种新的双正交小波构造方法,通过预测算子,确定高频信息,并初步确定低频信息,然后通过更新算子,对初步确定的低频信息进行修正,从而确定低频信息。它在空域对信号进行变换,完成了对信号频域的分析。在图像处理中,基于离散小波变换的提升算法比传统的卷积算法运算简单,实时性好,易于实现,因而被新一代图像压缩标准JPEG2000所采用。文中简要介绍了小波提升算法的原理,分析了其特点,并介绍了JPEG2000标准中采用的W5/3、D9/7两种小波的提升格式和实现算法。 相似文献
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A 320×240 CMOS image sensor is demonstrated,which is implemented by a standard 0.6 μm 2P2M CMOS process.For reducing the chip area,each 2×2-pixel block shares a sample/hold circuit,analog-to-digital converter and 1-b memory.The 2×2 pixel pitch has an area of 40 μm×40 μm and the fill factor is about 16%.While operating at a low frame rate,the sensor dissipates a very low power by power-management circuit making pixel-level comparators in an idle state.A digital correlated double sampling,which eliminates fixed pattern noise,improves SNR of the sensor, and multiple sampling operations make the sensor have a wide dynamic range. 相似文献
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本文在分析混合分形零树小波图像编码算法(FZW)优缺点的基础上,提出一种新的基于方向性小波子树的分形图像编码算法。该算法结合零树小波编码和分形编码,通过在匹配搜索过程中使用方向性range和domain子树,提高匹配精度,改善了传统分形小波图像压缩中的方块效应,更大限度的保留了图像的边缘信息。实验结果表明,该算法在提高压缩比和去除图像的方块效应方面,均取得了良好的效果。 相似文献
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Brian H Feria 《Image and vision computing》1987,5(4):267-278
Digital monochromatic images are encoded using a novel minimum mean square error (MSE) linear predictive transform (LPT) coding formulation. The new formulation is appealing for two important reasons. First, it leads to simple coder implementation with a satisfactory signal-to-noise ratio (SNR). Second, it provides a general theoretical framework from which minimum MSE predictive coding and minimum MSE transform coding arise as special cases. Some specific results of this paper that illustrate the previous ideas are: a simple and generally suboptimum two-dimensional LPT coder operating at 2 bit pixer−1 has approximately one third the complexity of a 4 × 4 Hadamard coder while yielding a better SNR; an optimum 2D LPT coder operating at 2 bit pixer−1 has approximately one sixth the complexity of a 4 × 4 Karhunen-Loeve transform (KLT) coder while yielding a better SNR. 相似文献
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