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61.
本文基于低密度奇偶校验码(Low-Density Parity-Check,LDPC)译码中的Turbo迭代的消息传递(Turbo Decoding Message Passing,TDMP)算法,设计了一种符合DMB-T标准的LDPC译码器。文章中结合DMB-T标准中H矩阵的特点,提出了一种基于双堆栈的快速Bahl-Cocke-Jelinek-Raviv(BCJR)译码运算的软输入软输出(SISO)译码器模块设计,并提出了一种基于循环偏移的可编程交织器设计。 相似文献
62.
LDPC码在深空通信中有很好的实用价值,同时LDPC码也被广泛应用于光纤通信、卫星数字视频和音频广播等领域。针对LDPC译码器提出一种新的设计思路,将流水线思想从译码算法本身扩展到译码器的整体设计中,设计出可以多帧并行且结构简单的译码器,最后从吞吐量和资源消耗两方面进行仿真验证。 相似文献
63.
64.
本文介绍7bit非系统形式汉明码的线性分组编码原理,结合其独特的监督矩阵、生成矩阵、伴随式和错误图样,提出一种简易的伴随式译码方法。在Protel DXP电路设计平台上,以汉明码伴随式译码器为实例,通过电路编译和仿真,验证汉明码的纠错码功能。 相似文献
65.
66.
设计了一种适用于导航系统的低功耗、串行维特比译码器电路.介绍了设计的维特比译码器电路的整体结构和各部分硬件电路的设计与特点,仿真结果显示设计的维特比译码器电路能够正常译码,并能纠正传输过程中的错误比特;SMIC0.18μm工艺下的综合结果表明译码器电路的面积只有4102门,功耗为399.514μW. 相似文献
67.
介绍了一种基于单片机的HDB3编/译码器的设计.以常用的51系列单片机为核心,结合外围电路,实现了HDB3编/译码器的功能.在单片机应用系统之间的数字基带通信中,具有一定的应用前景. 相似文献
68.
Viterbi译码算法用FPGA实现时,其硬件资源消耗与译码速度始终是相互制约的两个方面,通过合理安排ACS单元和路径度量存储单元可有效缓解这两方面的矛盾。本文以(2,1,6)卷积码为例,基于基4算法提出的动态路径度量存储管理方法能在不影响译码速度的前提下有效降低译码器的硬件复杂度。 相似文献
69.
70.
美信通HL9918(5)P/TSD型数字录音电话机是在电话答录机的基础上改进而成的,是一种采用微处理器控制,并采用语言处理器和高容量存储器实现数字录放功能的第三代数字录音电话机。该机由电话机电路和数字录音电路两大部分组成,数字录音电路主要由微处理器5U1(Z86E0812PSC)、单音译码器5U2(LM567)、语言处理电路5U3(TC8831)、动态存储器5U4~5U7及其外围元器件组成。本文仅介绍数字录音电路部分常见故障及其检修方法,以供参考。 相似文献