一种频率合成器的建模优化与电路设计

根据数模混合集成电路系统级和行为级快速验证的需求,设计了一种卫星导航系统射频接收机前端的频率合成器。传统行为级模型一般是基于理想环路进行参数提取,误差较大。为此,首先,分别利用MATLAB和Verilog-AMS对频率合成器建立理想行为级模型与非理想行为级模型,并根据行为级模型提取与优化的环路参数,采用SMIC 180 nm CMOS工艺设计仿真电路级频率合成器;其次,建立MATLAB噪声模型,对电路级各个模块的噪声进行拟合,评估频率合成器系统的整体噪声性能。所提出的频率合成器设计方法对电路级设计具有前瞻性的指导,并有助于电路级的设计优化。     

PLL频率合成器中有源环路滤波器的设计与仿真

为提高PLL频率合成器的性能,简化环路滤波器的设计过程,提出了PLL频率合成器中有源环路滤波器的一种设计方法。首先给出一种实用的三次特性的有源环路滤波器结构,根据电路结构求出其频率特性,结合PLL频率合成器中鉴相器-VCO-分频器的相位传递函数,确定使系统稳定的相位最大返回处频率,合理分配滤波器的零、极点,进而综合出环路滤波器的设计方法,以及电路中各元件的计算公式。文中给出了设计实例并进行了PSPICE仿真,结果表明其性能完全能达到设计要求。     

锁相环频率合成器捕捉过程的分析与仿真

锁相环频率合成器在射频通信电路中有广泛的应用,频率合成器的捕捉时间是很重要的性能指标.介绍了锁相频率合成器的基本原理,重点分析了环路的传递函数及环路滤波器在其中的影响,对频率响应过程进行了仿真分析.     

L波段低相噪、快锁定频率合成器研制

小数分频（FNPLL）频率合成器是近年来出现的一种新技术,它与传统的整数分频频率合成器相比具有频率分辨率高、相位噪声低、快速锁定等优点。用ANALOGDE．VICES公司的最新的小数分频锁相环频率合成器芯片ADF4193,设计了一个L波段锁相环频率合成器。文章系统地阐述了ADF4193的组成、工作原理,使用ADISimPLL软件进行环路滤波器设计,通过仿真得到各种性能指标,并对仿真结果和改变参数避开杂散的方法进行了详细分析。通过测试,结果证明了ADF4193组成的频率合成器具有优良的性能。     

CPT铷原子钟锁相环频率合成器设计和分析

基于CPT(相干布局囚禁)87铷原子钟设计出输出频率为3417 MHz的锁相环频率合成器,通过ADIsimPLL仿真出最佳环路带宽,环路滤波器参数以及相位噪声等,并通过STM32对锁相环芯片进行控制。对频率合成器进行了测试,电路尺寸为40 mm×40 mm,输出信号功率范围为-4 dBm^+5 dBm可调,输出信号噪声满足要求-88.65 dBc/Hz@1 kHz,-92.31 dBc/Hz@10 kHz,-104.63 dBc/Hz@100 kHz,杂散和谐波得到抑制,设计的频率合成器能很好的应用于原子钟的射频信号源。     

800 MHz射频频率合成器的设计及相位噪声性能分析

介绍了3．5GHz宽带无线固定接入系统射频接收机中800MHz频率合成器的设计,讨论了环路滤波器以及压控振荡器等环路部件对频率合成器输出信号相位噪声性能的影响,提出了低相位噪声频率合成器的设计方法。最后结合实际系统分析了本振信号相位噪声对基带接收机16QAM解调误码性能的影响,并给出计算机仿真的结果。     

基于ADF4107的锁相环仿真

本文根据锁相环的设计原理,基于锁相芯片ADF4107,利用AD公司的ADIsimPLL软件对锁相环外围电路进行了仿真,得到环路滤波器中的各个元件值,并利用其值,进行了实际的电路设计和制作,测试结果显示锁相环频率合成器工作性能良好。     

锁相环环路滤波器噪声特性分析与仿真

为估计环路滤波器对锁相频率合成器输出相位噪声的贡献,建立了一种常用的有源差分环路滤波器噪声模型,并推导出滤波器中各噪声源贡献的噪声的理论公式。针对一实际滤波器贡献的相位噪声进行理论计算,考虑了滤波器中运放的非理想特性后,对滤波器中各个噪声源贡献的相位噪声进行了仿真。通过理论结果和仿真结果对比,得出理论公式对实际环路滤波器噪声进行了很好的估计。最后给出环路滤波器设计时在噪声性能方面的考虑。     

基于频率合成器PE3236的电路设计

频率合成器PE3236是Peregrine公司生产的单片频率合成器.本文简单介绍了PE3236的特点,并结合具体实际的工程应用说明了使用PE3236设计频率合成器的方法,实现了一种L波段的锁相环频率合成器.通过分析PE3236和频率合成器的特性,结合使用环路滤波器和压控振荡器等主要器件,完成了锁相环频率合成电路的设计.测试结果表明频率合成器环路工作稳定,并且可以根据需要改变频率,体现了锁相环频率合成器的输出信号频率稳定度高等特点.     

四阶锁相跳频源环路参数的准确设计与仿真

锁相跳频源以其自身的性能优点,已经成为现代微波频率源的主要设计方案。针对目前流行的电荷泵锁相频率合成器芯片,提出一种根据环路带宽、相位裕量、鉴相频率泄漏抑制度等环路参数推导出的三阶环路滤波器准确设计方法,并给出了仿真流程。最后,用ADS软件仿真了一个S波段的锁相跳频源,验证了此方法的准确性。     

二波段频率源设计

为了设计一个L波段频率源,使其能够稳定输出,采用锁相倍频电路实现高频信号输出,通过Q3236锁相环芯片实现。利用有源比例积分滤波器实现环路滤波器的设计,给出了滤波器参数计算方法。做了大量关于锁相环电路和环路滤波器电路的实验,反复调试得到电路稳定工作最佳状态。最后给出了样机的测试结果,该频率源具有体积小、低功耗、低相噪及频率稳定性好等优点。     

低相噪数字锁相环式频率综合器

介绍低相噪NPLL频率综合器的设计及实验结果。提出用无源环路滤波器比用有源环路滤波器更好,可获得低相噪设计。     

基于ADF4350锁相频率合成器的频率源设计与实现

介绍了ADF4350锁相频率合成器的内部结构,在此基础上,分析和探讨了ADF4350锁相频率合成器的基本原理和工作特性.结合ADF4350的工作特性,给出了一种用AVR单片机控制ADF4350锁相频率合成器的频率源设计方法.对于环路滤波器,运用ADIsimPLL软件进行仿真和设计.通过对锁相环硬件电路的调试和编写相关单片机控制程序,实现了一个性能较好的频率源.     

锁相环环路滤波器的模拟设计

介绍了ADI SimPLL Ver2模拟软件的性能及特点,并阐明了利用该软件设计不同频率下环路滤波器(低通滤波器)的方法,环路滤波器是频率合成器的关键部分,直接影响无线通讯的载波质量、接收性能、发射和接收信噪比、接收灵敏度、通讯距离等,严重的会影响到频率的合成。导致系统瘫痪。该模拟软件具有功能强大、快捷、方便的特点,能对不同的频率进行准确、可靠的模拟,设计出合理、稳定的环路滤波电路。保证整个系统的需要,可广泛地应用于GSM、CDMA、WLAN、对讲机等移动通信领域。     

显示控制CMOS锁相环频率合成器设计

从工程的角度出发,设计了一个应用于显示控制芯片的新颖实用的CMOS锁相环频率合成器.详细论述了系统设计的关键问题,研究了电荷泵充放电电流匹配、精度和输出电压等工程设计问题,并对环路滤波器的计算和仿真以及压控振荡器的噪声性能进行了研究.采用1st Si 0.25μm的CMOS混合信号工艺对整个电路系统进行了带版图寄生的后仿真,仿真结果表明锁相环频率合成器设计的正确性.     

一种宽带低相噪频率合成器的设计方法研究

提出了一种宽带低相噪频率合成器的设计方法.采用了数字锁相技术,该锁相技术主要由锁相环（phase locked loop,PLL）芯片、有源环路滤波器、宽带压控振荡器和外置宽带分频器等构成,实现了10~20 GHz范围内任意频率输出,具有输出频率宽、相位噪声低、集成度高、功耗低和成本低等优点.最后对该PLL电路杂散抑制和相位噪声的指标进行了测试,测试结果表明该PLL输出10 GHz时相位噪声优于-109 dBc/Hz@1 kHz,该指标与直接式频率合成器实现的指标相当.